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淡江大學 電機工程學系碩士在職專班 周建興所指導 詹博宇的 解決固態硬碟對電腦無線網路干擾之研究 （2020），提出ddr4超頻記憶體關鍵因素是什麼，來自於固態硬碟SSD、通訊干擾、2.4G頻率、資料吞吐量(Throughput)。
而第二篇論文國立交通大學 資訊科學與工程研究所 陳添福所指導 彭胤淇的 多核心系統中記憶體架構之節能與效能優化技術 （2016），提出因為有 多核心、探聽過濾器、硬體預取、服務品質、排程器、記憶體控制器的重點而找出了 ddr4超頻記憶體的解答。
ddr4超頻記憶體進入發燒排行的影片
這次Computex中，威剛科技在攤位展出了超頻版 ADATA DDR4 ， 新一代的記憶體 DDR4 擁有更高的傳輸速度以及更低的耗電量，目前處於隨時將面市的情況，請看今天TechaLook的訪問。
特別感謝 ADATA 產品經理 Jacky 為我們的解說！
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解決固態硬碟對電腦無線網路干擾之研究
為了解決ddr4超頻記憶體 的問題，作者詹博宇 這樣論述：
在現代的社會上，隨著電子科技的發達，以及無線網路科技的進步，無線通訊WIFI技術由一開始的IEEE802.11a/b/g的單一輸入單一輸出SISO系統技術演變為IEEE802.11n/ac的多輸入多輸出MIMO系統，甚至於最近這三年更新的IEEE802.11ax技術，頻段也從原本的2.4G(2.412GHz-2.484GHz)、5G(5.15GHz-5.725GHz)擴展到6G(5.925GHz-7.125GHz)，來達到更多、更快速、更低延遲的資訊傳輸。近代電腦的產品逐漸講究輕薄、小型，其電子產品裝置傳輸的速度及頻率也越來越高，而這些輕薄的電腦在眾多的裝置發射之雜訊於小空間裡的相互干擾，尤
其目前都會使用到的序列通用匯流排USB3.x、記憶體Memory以及固態硬碟SSD，本論文主要是針對固態硬碟SSD在M.2 PCIE的介面上使用時產生高頻率的雜訊，由傳輸耦合或著是輻射散發將這雜訊耦合到無線網路使用的裝置通訊2.4G頻率上，間接影響到電腦無線通訊的性能及資料的傳輸率。本論文探討的WLAN的通訊干擾問題是藉由電場、磁場的測試方式來確認干擾的來源以及路徑，並且以Layout的佈線及輔料(如Gasket、Aluminium foil、Mylar)的機構對策破壞傳輸路徑、吸波材的使用來抑制雜訊，藉以分析這些solution針對SSD是否能夠符合客戶提供的無線通訊規範，兼顧對無線網路通訊
的電磁雜訊干擾問題且提高WLAN的資料吞吐量(Throughput)。
多核心系統中記憶體架構之節能與效能優化技術
為了解決ddr4超頻記憶體 的問題，作者彭胤淇 這樣論述：
多核心系統中，共享記憶體的資源是有限的，其包含共享快取記憶體、快取一致性匯流排、記憶體控制器等，如何妥善地分配給各個核心使用，是一大挑戰。此論文將著眼於三個關於共享記憶體管理和系統效能上的問題，並提出我們設計的記憶體架構，以實現低功耗、高效能之多核心系統。隨著核心數越來越多，快取一致性所耗的能源也越來越多，雖然有探聽過濾器可以減少執行快取一致性時，查詢快取的需求以減少能源消耗，但探聽過濾器將隨著時間而喪失其過濾的能力，進而無法減少查詢快取的需求。為了克服此問題，我們設計一個主動式活化的探聽過濾器架構，讓探聽過濾器回復其過濾能力，以減少能源消耗。我們的設計使用非常少的硬體成本，相較於先前的研究
可以減少50%的能源消耗。硬體預取是常用來增進系統效能的方法，主因是可以隱藏至主記憶體抓取資料所花的時間。但當硬體預取抓太多資料進快取時，會發生快取的汙染以及晶片外頻寬的增加，反而造成系統效能的惡化。我們設計一個動態調適的硬體預取，減少晶片外頻寬的使用量，也增進系統效能。晶片設計的趨勢逐漸朝往異質性發展，意味著多種不同的處理單元(如：中央處理器、繪圖處理器、多媒體加速器等等)將包含於同個晶片中，其彼此之間的干擾將嚴重影響效能，我們設計一個服務質量引擎來管理這些處理單元存取主記憶體控制器時的要求，並提供系統三種服務質量模式，以克服不同情境的效能以及功耗要求。